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signale_multilayer_pad_clearance

autodeskguest

Hallo,

 

mein Problem besteht im Verbinden von gleichen Signalen auf mehreren Layern.

Ich habe einen Spulenhalter, an dem nur ein Pin im Schaltplan

angeschlossen ist (der Übersichtlichkeit halber), allerdings in meiner

Bibliothek mehrere Pins vorhanden sind und auch im Board aufscheinen.

 

Nun möchte ich mein Signal an diesen Pin führen und die gleiche Leitung

auch an die anderen Pins führen. Das soll auf mindestens 2 Lagen so sein.

Lege ich nun - per Wire und nicht per Route - auf einem anderen Layer

als dem per Route gelegten Signal ein Wire über dieses (oder ein

Nachbarspin) bereits verbundene Pin, bekomme ich beim DRC einen

Clearance-Fehler (mit den 4Layer Design-Regeln von PCB-Pool).

 

Alle Wires haben die gleiche Bezeichnung - ein Hinzufügen von Vias (auch

alle mit dem gleichen Namen) ändert nichts am Clearance-Fehler.

 

Leider habe ich weder im Handbuch noch in der Newsgroup einen Hinweis

gefunden, wie ich dieses leidige Problem beheben kann.

 

Weiß jemand Rat - im Einsatz ist 4.16r2?

 

Besten Dank

Ronny

 

ps: Selbes Problem tritt auch bei anderen Bauteilen (Sicherungshalter)

auf, an denen ich nur ein Pin im Schaltplan verbunden habe und das

zweite Pin am Board hinzugenommen habe.

 

 

Parents

  • Ronny Plattner schrieb:

    Okay. Wie geht man am Besten vor, wenn man ein Bauteil hat

    (Spulenträger), welches über viele Anschlußpins verfügt, man aber nicht

    alle im Schaltplan sichtbar haben möchte (und klarerweise einen sauberen

    DRC-Durchlauf möchte).

     

    In wie weit stört es sie, daß die Pins sichtbar sind, bzw. könnte man

    die nicht gewünschten Pins auf eine weitere Schaltplanseite platzieren

    und hier mit dem entsprechenden Netz verbinden. ?

     

    Oder ausnahmsweise im Symbol das Grid auf 50 oder 25 mil stellen, die

    Pins (Short) knapp nebeneinander setzen (als wäre es ein etwas längerer

    Pin) und dann im SCH ebenfalls im GRID 25mil das NET an die Pins

    anschließen. image

     

    Meine Lösung sieht derzeit so aus, daß ich in meiner Bibliothek die

    bisher nicht zugeordneten Pins (das sind eh genau die, bei denen der DRC

    anschlägt) in die Symbol-Package-Pin Zuordnung aufgenommen habe.

    Also die im Package benutzten, aber nicht im Symbol eingerichteten Pins

    im Symbol hinzugefügt und verbunden habe.

    Nun sind diese im Schaltplan sichtbar - der DRC zeigt keine Fehler mehr

    an - also alles in Butter (ich sehe im Schaltplan nun halt viele Pins).

     

    Eine andere Lösung wäre wohl, im Board durchkontaktierte Bohrungen an

    den richtigen Stellen vorzusehen, Namen zuzuweisen und das Signal

     

    Also mit VIAs.

     

    (gleichen Namens) darüber zu legen. Leitung auf anderen Layer kopieren

    (selber Name) ... der DRC dürfte dann nichts mehr melden. Sehe ich das

    richtig?

     

    Ja.

     

    --

    MfG / Best regards

      A. Zaffran

     

    Hotline 08635-698930, FAX 08635-698940, eMail <alf@cadsoft.de>

    CadSoft Computer GmbH, Hofmark 2, 84568 Pleiskirchen

    Registergericht: Amtsgericht  Traunstein HRB 5573

    Geschäftsführer: Dipl.-Ing. (FH) Rudolf Hofer, Dipl.-Ing. Klaus Schmidinger

     

Reply

  • Ronny Plattner schrieb:

    Okay. Wie geht man am Besten vor, wenn man ein Bauteil hat

    (Spulenträger), welches über viele Anschlußpins verfügt, man aber nicht

    alle im Schaltplan sichtbar haben möchte (und klarerweise einen sauberen

    DRC-Durchlauf möchte).

     

    In wie weit stört es sie, daß die Pins sichtbar sind, bzw. könnte man

    die nicht gewünschten Pins auf eine weitere Schaltplanseite platzieren

    und hier mit dem entsprechenden Netz verbinden. ?

     

    Oder ausnahmsweise im Symbol das Grid auf 50 oder 25 mil stellen, die

    Pins (Short) knapp nebeneinander setzen (als wäre es ein etwas längerer

    Pin) und dann im SCH ebenfalls im GRID 25mil das NET an die Pins

    anschließen. image

     

    Meine Lösung sieht derzeit so aus, daß ich in meiner Bibliothek die

    bisher nicht zugeordneten Pins (das sind eh genau die, bei denen der DRC

    anschlägt) in die Symbol-Package-Pin Zuordnung aufgenommen habe.

    Also die im Package benutzten, aber nicht im Symbol eingerichteten Pins

    im Symbol hinzugefügt und verbunden habe.

    Nun sind diese im Schaltplan sichtbar - der DRC zeigt keine Fehler mehr

    an - also alles in Butter (ich sehe im Schaltplan nun halt viele Pins).

     

    Eine andere Lösung wäre wohl, im Board durchkontaktierte Bohrungen an

    den richtigen Stellen vorzusehen, Namen zuzuweisen und das Signal

     

    Also mit VIAs.

     

    (gleichen Namens) darüber zu legen. Leitung auf anderen Layer kopieren

    (selber Name) ... der DRC dürfte dann nichts mehr melden. Sehe ich das

    richtig?

     

    Ja.

     

    --

    MfG / Best regards

      A. Zaffran

     

    Hotline 08635-698930, FAX 08635-698940, eMail <alf@cadsoft.de>

    CadSoft Computer GmbH, Hofmark 2, 84568 Pleiskirchen

    Registergericht: Amtsgericht  Traunstein HRB 5573

    Geschäftsführer: Dipl.-Ing. (FH) Rudolf Hofer, Dipl.-Ing. Klaus Schmidinger

     

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