Die falsche Fehlermeldung tritt auf wenn ich ein Bauteil mit Polygonen und
PAD in der Nähe des Platinenursprungs (0 0) platziere.
Anbei ein Screenshot und ein Muster.brd zum Nachvollziehen.
Das "Top-Rechteck" ist nur drinn damit man den Fehler auch einfach sieht.
Jedes andere CU (Pad oder Leiterbahn) an der Stelle wo der DRC-Fehler
gemeldet wird zeigt dort auch einen Overlap-Fehler.
Mache ich da was falsch?
Gruß
Jan Hänel
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