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VCC mit zweiter Fläche und VIA verbinden

autodeskguest

Hallo,

ich habe auf meiner zweiseitigen Platine eine Massefläche auf Bottom und

eine VCC Fläche auf Top. An einer Stelle schnüre ich VCC jedoch aufgrund

eines IC's ein. Um eine "breitere" Verbindung zu haben, möchte ich VCC

mit Hilfe von VIA's auf eine Ploygon auf Bottom legen, dann mit dieser

kleinen Fläche die Einschnürung überbrücken und dann wieder mit VIA's

zurück auf die Top-Lage wechseln. Leider bekomme ich das nicht hin. Der

DRC meldet immer "Clearance". Die VCC Fläche und die VIA's habe ich mit

"name" VCC genannt. Aussehen tut es dann wie gewollt, nur der DRC hat

leider was dagegen image

Hoffe jemand versteht was ich meine und kann mir Helfen.

Schon mal Danke.

 

Gruß

Markus

 

  • Markus Schneiders schrieb:

    Hallo,

    ich habe auf meiner zweiseitigen Platine eine Massefläche auf Bottom und

    eine VCC Fläche auf Top. An einer Stelle schnüre ich VCC jedoch aufgrund

    eines IC's ein. Um eine "breitere" Verbindung zu haben, möchte ich VCC

    mit Hilfe von VIA's auf eine Ploygon auf Bottom legen, dann mit dieser

    kleinen Fläche die Einschnürung überbrücken und dann wieder mit VIA's

    zurück auf die Top-Lage wechseln. Leider bekomme ich das nicht hin. Der

    DRC meldet immer "Clearance". Die VCC Fläche und die VIA's habe ich mit

    "name" VCC genannt. Aussehen tut es dann wie gewollt, nur der DRC hat

    leider was dagegen image

    Hoffe jemand versteht was ich meine und kann mir Helfen.

    Schon mal Danke.

     

    Gruß

    Markus

     

    Liegt dann das kleine VCC-Polygon innerhalb des GND-Polygons?

    Wenn ja, müssen Sie den RANK für das große Polygon ändern, so

    dass es vom VCC-Polygon verdrängt werden kann.

     

     

    --

    Mit freundlichen Gruessen / Best regards

    Richard Hammerl

      CadSoft Support -- hotline@cadsoft.de

      FAQ: http://www.cadsoft.de/faq.htm

     

  • in reply to Richard_H

    Richard Hammerl schrieb:

    Markus Schneiders schrieb:

    Hallo,

    ich habe auf meiner zweiseitigen Platine eine Massefläche auf Bottom

    und eine VCC Fläche auf Top. An einer Stelle schnüre ich VCC jedoch

    aufgrund eines IC's ein. Um eine "breitere" Verbindung zu haben,

    möchte ich VCC mit Hilfe von VIA's auf eine Ploygon auf Bottom legen,

    dann mit dieser kleinen Fläche die Einschnürung überbrücken und dann

    wieder mit VIA's zurück auf die Top-Lage wechseln. Leider bekomme ich

    das nicht hin. Der DRC meldet immer "Clearance". Die VCC Fläche und

    die VIA's habe ich mit "name" VCC genannt. Aussehen tut es dann wie

    gewollt, nur der DRC hat leider was dagegen image

    Hoffe jemand versteht was ich meine und kann mir Helfen.

    Schon mal Danke.

     

    Gruß

    Markus

     

    Liegt dann das kleine VCC-Polygon innerhalb des GND-Polygons?

    Wenn ja, müssen Sie den RANK für das große Polygon ändern, so

    dass es vom VCC-Polygon verdrängt werden kann.

     

     

    Ja das kleine VCC-Polygon liegt innerhalb der GND-Fläche.

    Mit RANK hat es wunderbar funktioniert. Der DRC hat jetzt nichts mehr

    dagegen image

     

    Vielen Dank für die Hilfe.

     

    Markus