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EAGLE Support (Deutsch) Aussparungen innerhalb von Polygonen in den Innenlagen
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Related

Aussparungen innerhalb von Polygonen in den Innenlagen

autodeskguest
autodeskguest over 17 years ago

Hi,

 

ich habe häufig das Problem, dass ich innerhalb eines Polygons in der

Innenlage (Versorgungsspannung) einige Stellen aussparen möchte. Bisher

sind mir dafür zwei Lösungen bekannt, die mir aber beide ganz und gar

nicht gefallen.

 

1) Die auszusparende Fläche mit einem Wire mit Breite 0 zeichnen.

Solange beim Polygon Orphans = off gesetzt ist wird diese Fläche dann

freigestellt. Die Wires sind so schmal, dass sie nicht mitgefertigt

werden. Der Nachteil ist, dass es dadurch etliche DRC-Fehler gibt.

 

2) Mehrere Polygone so aneinander legen, dass man an der Nahtstelle

zwischen den einzelnen Polygonen die auszusparenden Flächen frei lässt.

Das klappt noch ganz gut, wenn man nur ein oder zwei freie Stellen

braucht, aber bei 10 oder mehr solcher Stellen, die über die ganze

Platine verstreut liegen ist das extrem umständlich.

 

Daher meine Frage: Gibt es da vielleicht noch eine einfachere Methode

die ich bisher übersehen habe?

 

Gruß

Christian Köster

 

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  • Former Member
    Former Member over 17 years ago

    Christian Koester schrieb:

    Hi,

     

    ich habe häufig das Problem, dass ich innerhalb eines Polygons in der

    Innenlage (Versorgungsspannung) einige Stellen aussparen möchte. Bisher

    sind mir dafür zwei Lösungen bekannt, die mir aber beide ganz und gar

    nicht gefallen.

     

    1) Die auszusparende Fläche mit einem Wire mit Breite 0 zeichnen.

    Solange beim Polygon Orphans = off gesetzt ist wird diese Fläche dann

    freigestellt. Die Wires sind so schmal, dass sie nicht mitgefertigt

    werden. Der Nachteil ist, dass es dadurch etliche DRC-Fehler gibt.

     

    Nicht wenn man Netz-CLASSen benutzt. image

     

    2) Mehrere Polygone so aneinander legen, dass man an der Nahtstelle

    zwischen den einzelnen Polygonen die auszusparenden Flächen frei lässt.

    Das klappt noch ganz gut, wenn man nur ein oder zwei freie Stellen

    braucht, aber bei 10 oder mehr solcher Stellen, die über die ganze

    Platine verstreut liegen ist das extrem umständlich.

     

    Daher meine Frage: Gibt es da vielleicht noch eine einfachere Methode

    die ich bisher übersehen habe?

     

    Nein.

     

    --

    MfG / Best regards

      A. Zaffran

     

    Hotline 08635-698930, FAX 08635-698940, eMail <alf@cadsoft.de>

    CadSoft Computer GmbH, Hofmark 2, 84568 Pleiskirchen

    Registergericht: Amtsgericht  Traunstein HRB 5573

    Geschäftsführer: Dipl.-Ing. (FH) Rudolf Hofer, Dipl.-Ing. Klaus Schmidinger

     

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  • Former Member
    Former Member over 17 years ago

    Christian Koester schrieb:

    Hi,

     

    ich habe häufig das Problem, dass ich innerhalb eines Polygons in der

    Innenlage (Versorgungsspannung) einige Stellen aussparen möchte. Bisher

    sind mir dafür zwei Lösungen bekannt, die mir aber beide ganz und gar

    nicht gefallen.

     

    1) Die auszusparende Fläche mit einem Wire mit Breite 0 zeichnen.

    Solange beim Polygon Orphans = off gesetzt ist wird diese Fläche dann

    freigestellt. Die Wires sind so schmal, dass sie nicht mitgefertigt

    werden. Der Nachteil ist, dass es dadurch etliche DRC-Fehler gibt.

     

    Jedes Wire-Segment in einem Kupferlayer (1 - 16) im Board besitzt

    einen Signalnamen. Eagle unterscheidet zwischen echten Signalen,

    die an PADs oder SMDs angeschlossen sind, und unechten Signalen

    die ebenfalls einen Signal-Namen besitzen, aber nicht an PADs

    oder SMDs angeschlossen sind.

    Der DRC überprüft alle Elemente mit den Design-Regeln und den Werten

    der Netz-CLassen. Der größere Wert muß eingehalten werden!

     

    Ist eine Wire ein unechtes Signal (Netz), so wird es nur mit

    den Design-Regeln geprüft. Ist es ein echtes Signal, so wird es

    zusätzlich mit den (größeren) Werten der CLASS geprüft.

    Dadurch kann man sich in Kupfer selbst ein Logo aus WIRE, RECT,

    CIRCLE oder TEXT zusammensetzen ohne daß der DRC einen Width- bzw.

    einen Clearance-Fehler meldet in dem man im DRC unter Sizes:

    für min. Width den Wert 0, so wie unter Clearance: Wire - Wire

    ebenfalls den Wert 0 angibt. Hier muß dann selbstverständlich in der

    CLASS der Wert für min.Width und Clearance angegeben werden!

     

    Beachten Sie, daß in Geber die Breite 0 nicht verwendet werden kann.

    Es ergibt sich ein Widerspruch. Blende 0 (also zu) aber Licht ein!

    Es wird hier die Tatsache genutzt, das so dünne Linien nicht

    geplottet, bzw. nicht geätzt werden können (Unterätzen).

     

    --

    MfG / Best regards

      A. Zaffran

     

    Hotline 08635-698930, FAX 08635-698940, eMail <alf@cadsoft.de>

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    Geschäftsführer: Dipl.-Ing. (FH) Rudolf Hofer, Dipl.-Ing. Klaus Schmidinger

     

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