Hallo,
ich habe einige Bauteile erstellt und dabei aus der Lib ref-packages.lib die Footprints für 48TQFP und 48TSSOP verwendet. Nun möchte ich diese Bauteile auf meiner Platine routen, bekomme aber vom Design Rule Check Fehler in der Clearance. Der Abstand zwischen den Pads beträgt 7.4 mil. Nach meinem Verständnis dürfte der DRC keine Fehler mehr anzeigen, wenn ich die Clearanceeinstellungen auf 7 mil setze. Jedoch werden trotzdem Fehler angezeigt. Probeweise habe ich, wie im angehängten Screenshot zu sehen, die Clearance Einstellungen auf 1 mil heruntergestellt. Hier dürften ja eigentlich gar keine Fehler mehr auftauchen. Jedoch ändert sich an den Fehlern nichts.
Woran liegt das, bzw. wie kann ich das beheben?
Viele Grüße, Andreas
